Epoch IC design system response to VHDL/VITAL requirements

机译：EPOCH IC设计系统对VHDL /重要要求的响应

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This paper describes the impact that recent changes to VHDL in the area of ASIC modeling will have upon the Epoch IC design system. Epoch delay modeling and simulation support have been implemented to provide for the critically important needs of post-layout simulation.

机译：本文介绍了最近对ASIC建模领域的VHDL变化的影响将在EPOCH IC设计系统上。已经实施了纪元延迟建模和仿真支持，以提供后布局模拟的批判性重要需求。

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来源
《Northcon 》|1994年||共4页
会议地点
作者
Hinchliffe F. II; Institute of Electric and Electronic Engineer;
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原文格式 PDF
正文语种
中图分类自动化技术、计算机技术 ;
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