Design of a 4/spl times/4 Kohonen neural net-VHDL description

机译：设计4 / SPL时间/ 4 Kohonen神经网络VHDL描述

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The VHDL modeling and ensuing simulation results for a 4/spl times/4 cells Kohonen neural net are presented. The net cells were modeled in behavioral VHDL as components and were instantiated in the neural net structural description. The methodology described aims at automatic circuit synthesis for VLSI implementation.

机译：介绍了VHDL建模和随后的4 / SPL时间/ 4个细胞Kohonen神经网络的仿真结果。将净细胞以行为VHDL为组分建模，并在神经净结构描述中实例化。该方法描述了VLSI实现的自动电路合成。

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来源
《IEEE international caracas conference on devices, circuits and systems》|1995年||共4页
会议地点
作者
Jara Perez M.; Machaca Luque W.; Institute of Electric and Electronic Engineer;
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作者单位

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会议组织
原文格式 PDF
正文语种
中图分类电力系统的调度、管理、通信;
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