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A 34 Gbps Data Transmission System with FPGAs Embedded Transceivers and QSFP+ Modules

机译:具有FPGA嵌入式收发器和QSFP +模块的34 Gbps数据传输系统

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摘要

APEnet+ is our custom developed PCIe gen2 board based on an Altera Stratix IV FPGA. We demonstrate reliable usage of Altera's embedded transceivers coupled with QSFP+ (Quad Small Form Pluggable) technology. QSFP+ standard defines a hot-pluggable transceiver available in copper or optical cable assemblies for an aggregated bandwidth of up to 40 Gbps. We use embedded transceivers in a 4 lane configuration, each one capable of 8.5 Gbps, for an aggregate bandwidth of 34 Gpbs per link. On Stratix IV 290 we can place up to 6 bidirectional links, together with a PCIe gen2 x8 hard IP. We describe design and implementation of this data transmission system.
机译:Apenet +是我们的自定义开发的PCIe Gen2板,基于Altera Stratix IV FPGA。我们展示了Altera的嵌入式收发器的可靠用途,耦合了QSFP +(四边形小型可插拔)技术。 QSFP +标准定义铜或光缆组件中可用的热插拔收发器,用于聚合带宽高达40 Gbps。我们使用4车道配置中的嵌入式收发器,每个能够为8.5 Gbps,每个链路的聚合带宽为34个GPBS。在Stratix IV 290上,我们可以放置多达6个双向链接,以及PCIe Gen2 X8硬IP。我们描述了该数据传输系统的设计和实现。

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