Computer architecture; Throughput; Transforms; Complexity theory; Video sequences; Encoding; Standards;
机译:适用于8K×4K视频解码的高效区域HEVC IDCT / IDST架构
机译:具有HEVC标准的自适应块大小的全流水线二维IDCT / IDST VLSI架构
机译:使用Muxed-MCM问题的HEVC的区域和高效的可变变量DCT架构
机译:HEVC的区域高效DST架构
机译:使用基于样本的角度帧内预测(SAP)进行高效的HEVC更少损失的编码。
机译:与HEVC编码器有效组合的运动估计辅助降噪
机译:HEVC的区域有效DST架构