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Timing-driven hierarchical global routing with wire-sizing and buffer-insertion for VLSI with multi-routing-layer

机译：具有多路由层的VLSI的时序驱动的分层全局路由，具有布线大小和缓冲区插入功能

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来源
《Conference on Asia South Pacific design automation》|2000年|P.99-104|共6页
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作者
Takahiro Deguchi; Tetsushi Koide; Shinichi Wakabayashi; Shinichi Wakabayashi;
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作者单位

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正文语种
中图分类计算技术、计算机技术;
关键词

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