A Parallel FSM Design Method and its Application in Ten Gigabit Ethernet Access Chip

机译：并行FSM设计方法及其在十吉比特以太网接入芯片中的应用

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The data flow rate in Ten Gigabit Ethernet access chip is so high that the chip uses a 64-bit data channel. But the interface between the host and the access chip is 32-bit in width. So the chip needs a parallel interface and a parallel FSM that controls the interface. This paper presents a block diagram for the Ten Gigabit Ethernet access system and a solution for the parallel FSM design problem.

机译：十吉比特以太网访问芯片中的数据流是如此之高，以至于该芯片使用64位数据通道。但是主机和访问芯片之间的接口宽度为32位。因此，该芯片需要一个并行接口和一个控制该接口的并行FSM。本文提供了十吉比特以太网访问系统的框图以及并行FSM设计问题的解决方案。

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来源
《International Conference on ASIC; 20031021-20031024; Beijng; CN》|2003年|P.870-873|共4页
会议地点 BeijngCN
作者
Zhao Liu; Guowei Shi; Lieguang Zeng;
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作者单位

Department of Electronics Engineering Tsinghua University Beijing, P.R.China, 100084;

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会议组织
原文格式 PDF
正文语种 eng
中图分类计算技术、计算机技术;
关键词

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