stituto de Microelectronica de Sevilla/Universidad de Sevilla, Sevilla, Spain;
switching noise generation; clock circuits; submicron CMOS VLSI; mixed analog/digital circuits;
机译:一般VLSI电路中的时钟分配
机译:一般VLSI电路中的时钟分配
机译:Vlsi电路中的接地反弹噪声降低
机译:混合模式VLSI电路时钟分布的瘙痒降噪
机译:用于时钟系统的低功耗和高性能VLSI电路。
机译:用于超低噪声CMOS图像传感器的基于多采样的信号读取电路的降噪效果
机译:时钟策略对低开关噪声数字和混合信号VLSI电路设计的影响