Department of Computer Science, University of Regina 3737 Wascana Parkway Regina, Saskatchewan, S4S 0A2, Canada;
rnDepartment of Computer Science, University of Regina 3737 Wascana Parkway Regina, Saskatchewan, S4S 0A2, Canada;
VLSI circuits and systems; motion estimation; variable block size; H.264/AVC; parallel hardware architecture;
机译:H.264 / AVC的快速可变块大小运动估计架构的硬件实现和验证
机译:H.264 / AVC中可变块大小整数运动估计的内存高效且高度并行的体系结构
机译:用于H.264 / AVC中可变块大小运动估计的并行改进的HDTV720p定向传播部分SAD架构
机译:H.264 / AVC中可变块大小运动估计的快速和并行硬件架构
机译:H.264 / 4VC中用于快速运动估计的算法开发和硬件体系结构。
机译:快速并行串联质谱库使用GPU硬件加速搜索
机译:H.264 / aVC中全搜索可变块大小运动估计的高效硬件体系结构