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WU Chun-chun; 吴春春; HU Huai-xiang; 胡怀湘; ZHANG Chao; 张超; CHEN Xiang-yu; 陈相宇;
中国计算机学会;
国产服务器; 异构协同加速架构; 现场可编程逻辑门阵列; 计算性能;
机译:基于OpenCL的异构计算框架下基于FPGA的卷积神经网络加速器设计
机译:通过软件和硬件协同设计加速基于FPGA的SAT解算器
机译:基于FPGA的加速器,用于基于邻域的协同过滤推荐算法
机译:基于RTDS的电力系统协同仿真中的高频电力电子转换器的基于FPGA的模型。
机译:EDSSA:基于OpenCL的FPGA平台上的编码器 - 解码器语义分段网络加速器
机译:基于FPGA的硬件/软件协同仿真加速器
机译:基于异构高性能计算架构的基于协同的广域监视实时异常检测。
机译:生成时钟信号,以实现基于周期的,可重复的基于FPGA的FPGA硬件加速器
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