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基于FPGA的通用RS编解码器的VHDL设计方法

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本文利用VHDL中的枚举和函数重载功能定义伽罗华域中的各种"+"、"-"、"×"、"÷"运算,并且自定义了BCH解码中用到的函数和数据结构.这使得编写的程序更加接近理论上对RS码的描述,从而增加可读性,并且在程序调试时减少了工作量,提高了效率.仿真结果表明该方法具有实现容易的特点.

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来源
《第八届国际广播电视技术讨论会（ISBT’2003）》|2003年|40-44|共5页
会议地点北京
作者
梁炜新; 王群生; 牟刚;
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作者单位

中国电子学会;

中国电影电视技术学会;

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会议组织
正文语种
原文格式 PDF
中图分类设计、分析、计算;编码器;
关键词
Reed-Solomon码; VHDL; 伽罗华域; 函数重载; 数字通信系统; 编解码器; FPGA;
入库时间 2022-08-17 11:07:27

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