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翁志强; 王飙;
中国计算机学会;
江苏省计算机学会;
南京邮电大学;
多核处理器; 多线程处理器; Cache设计; 中央处理器; CPU;
机译:V-SET CACHE:多核处理器的有效自适应共享CACHE
机译:多核/多线程处理器中的多线程网络应用程序的线程分配
机译:低功耗非对称多核处理器的多线程密集线性代数库
机译:cachevisor:用于在多核和多线程处理器中可视化共享缓存的工具集
机译:一个有效的设计空间探索框架,用于优化省电的异构多核多线程嵌入式处理器体系结构。
机译:使用矢量化和多线程策略在基于多核的处理器上加速生物信息学应用程序
机译:使用自动多线程工作负载综合加速多核处理器设计空间评估
机译:用于多核平台的多线程DNa标签/反标签库生成器
机译:访问具有不同范围资源的微处理器中的资源,从而允许设计软件模拟多线程和多核微处理器。
机译:多线程处理器中共享分区缓存中的每个线程CACHELINE分配机制
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