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Memory module, parity bit emulator, and associated method for parity bit emulation

机译:存储器模块,奇偶校验位仿真器以及用于奇偶校验位仿真的关联方法

摘要

A memory module, parity bit emulator, and method which emulate storing and retrieving a parity bit from memory. The memory module includes a memory for storing a data word which is retrieved from the memory during the read cycle. The memory module also includes a parity bit emulator which includes a parity bit generator. The parity bit generator is responsive to the retrieved data word and generates in response a corresponding parity bit during the read cycle. The memory module also includes an input/output port for outputting the retrieved data word and the generated parity bit during the read cycle.
机译:一种存储器模块,奇偶校验位仿真器和方法,其模拟存储和从存储器中检索奇偶校验位。存储器模块包括用于存储在读取周期期间从存储器检索的数据字的存储器。存储器模块还包括奇偶校验位仿真器,该奇偶校验位仿真器包括奇偶校验位生成器。奇偶校验位生成器对检索到的数据字作出响应,并在读取周期内作为响应生成相应的奇偶校验位。存储器模块还包括输入/​​输出端口,用于在读取周期期间输出所检索的数据字和所生成的奇偶校验位。

著录项

  • 公开/公告号US5367526A

    专利类型

  • 公开/公告日1994-11-22

    原文格式PDF

  • 申请/专利权人 KONG;EDMUND Y.;

    申请/专利号US19930080699

  • 发明设计人 EDMUND Y. KONG;

    申请日1993-06-22

  • 分类号G06F11/10;H03M13/00;

  • 国家 US

  • 入库时间 2022-08-22 04:05:50

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