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机译:具有2n的读头布置是磁阻型的并且具有读头布置的重放布置。
公开/公告号AT130454T
专利类型
公开/公告日1995-12-15
原文格式PDF
申请/专利权人 PHILIPS ELECTRONICS N.V.;
申请/专利号AT19910201252T
发明设计人 HOLSTLAAN 6;SOMERS GERARDUS HENRICUS JOHANNUS;
申请日1991-05-27
分类号G11B5/39;
国家 AT
入库时间 2022-08-22 03:51:41
机译: 具有2n的读头布置是磁阻型的并且具有读头布置的重放布置。
机译: 进行逻辑和位置自变量模拟信号的模式在PRE加法器fΣ[ni]和[mi](2n)串行器中,乘积fΣ(Σ)的部分乘积的模拟信号项[ni] f(2n)和[mi] f(2n)对于双逻辑微分d / dn +和d / dn-小计,并将求和[Si] f(2n)整形为FORMAT位置
机译: 先验加法器f1(ΣCD)的功能结构条件“ j”放电串行化器MULTIPLIERfΣ(Σ),正在实现具有参数multiplicand [mj] f(2n)和乘数[ni]的结构的“ INTERPRETATION”参数部分乘积。 f(2n)位置格式“附加代码”和小数[1,2Sj h1] f(2n)在位置格式“附加代码RU”中的形成(OPTIONS RUSSIAN LOGIC)