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Bus bridge architecture for a data processing system capable of sharing processing load among a plurality of devices

机译:用于能够在多个设备之间共享处理负载的数据处理系统的总线桥体系结构

摘要

The method and apparatus provides a data processing system. The data processing system includes a primary bus, a secondary bus, and a host processor connected to the primary bus. The data processing system includes a first secondary processor connected to the primary bus and the secondary bus. Additionally, a second secondary processor is connected to the secondary bus. The first secondary processor and the second secondary processor forms cascaded processors for input/output functions. Selected functions normally performed by the second secondary processor are performed by the first secondary processor, wherein a division of workload increases performance of the data processing system. This architecture allows shifting of workload down to the secondary bus.
机译:该方法和设备提供了一种数据处理系统。数据处理系统包括主要总线,次要总线和连接到主要总线的主机处理器。该数据处理系统包括连接到主要总线和次要总线的第一次要处理器。另外,第二辅助处理器连接到辅助总线。第一辅助处理器和第二辅助处理器形成用于输入/输出功能的级联处理器。通常由第二辅助处理器执行的所选功能由第一辅助处理器执行,其中工作负荷的划分提高了数据处理系统的性能。这种架构允许将工作负载转移到辅助总线。

著录项

  • 公开/公告号US6065085A

    专利类型

  • 公开/公告日2000-05-16

    原文格式PDF

  • 申请/专利权人 LSI LOGIC CORPORATION;

    申请/专利号US19980013818

  • 发明设计人 LOUIS H. ODENWALD JR.;STEVEN R. SCHREMMER;

    申请日1998-01-27

  • 分类号G06F13/00;G06F13/40;

  • 国家 US

  • 入库时间 2022-08-22 01:37:06

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