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MPEG DECODE CIRCUIT PARALLEL DRIVE SYSTEM

机译:MPEG解码电路并行驱动系统

摘要

PROBLEM TO BE SOLVED: To provide inexpensive parallel drive system that employs a plurality of MPEG decode circuits to obtain a composite image. ;SOLUTION: A decode start time obtained by tracing back a display time decided by a decoder display time decision means of an MPEG decode circuit is compared with a decode start schedule time calculated from time stamp information extracted from a transport stream signal. When the decode start time is slower than the decode start schedule time by a prescribed time or longer, it is confirmed that the concerned image is not a reference image required for decoding other image, a decoder is controlled to stop decoding the image and an MPEG decode circuit among plural of MPEG decode circuits informs the other MPEG decode circuit of the display time.;COPYRIGHT: (C)2001,JPO
机译:解决的问题:提供一种廉价的并行驱动系统,该系统采用多个MPEG解码电路来获得合成图像。解决方案:将通过追溯由MPEG解码电路的解码器显示时间确定装置确定的显示时间而获得的解码开始时间与根据从传输流信号中提取的时间戳信息计算出的解码开始时间表时间进行比较。当解码开始时间比解码开始时间表时间慢规定时间或更长时间时,确认所关注的图像不是解码其他图像所需的参考图像,控制解码器以停止对该图像和MPEG进行解码多个MPEG解码电路中的一个解码电路将显示时间通知另一个MPEG解码电路。版权所有:(C)2001,JPO

著录项

  • 公开/公告号JP2001186529A

    专利类型

  • 公开/公告日2001-07-06

    原文格式PDF

  • 申请/专利权人 TOSHIBA CORP;

    申请/专利号JP19990370995

  • 发明设计人 KANO TAKASHI;

    申请日1999-12-27

  • 分类号H04N7/32;H04N5/66;

  • 国家 JP

  • 入库时间 2022-08-22 01:27:44

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