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CELL FOR DISCRETE TIME CELLULAR NEURAL NETWORK

机译:离散时间细胞神经网络细胞

摘要

PURPOSE: A cell, adopted in a discrete time cellular neural network, is provided to perform a multiplication operation by using a distributed process structure consisting of a memory, an adder and an accumulator so that it can reduce a complexity of the cellular neural network and realize a VLSI(Very Large Scale Integration) design. CONSTITUTION: The cell comprises a partial generator(102), an initial value register(104), an accumulator(106), a limiter(108), and an output register(110). The partial generator(102) generates N feedback data, consisting of a plurality of N-1 bit input data offered by adjacent N-1 cells and self feedback data, and a sequential partial multiplication result. The initial value register(104) stores a preset constant bias value. The accumulator(106) adds each partial multiplication result and the constant bias value or a previous addition result, and performs a shift operation for outputting an M bit multiplication result. The limiter(108) corresponds the M bit multiplication result to the bit number of the input data. The output register(110) stores the limited multiplication result, performs a self feedback on the stored limited multiplication result at a next multiplication operation or inputs the multiplication result to other adjacent cell as input data.
机译:目的:提供一种在离散时间细胞神经网络中采用的单元,通过使用由存储器,加法器和累加器组成的分布式过程结构来执行乘法运算,从而可以降低细胞神经网络的复杂性,并且实现超大规模集成(VLSI)设计。组成:该单元包括部分生成器(102),初始值寄存器(104),累加器(106),限制器(108)和输出寄存器(110)。部分生成器(102)生成由相邻的N-1个单元提供的多个N-1位输入数据和自反馈数据组成的N个反馈数据,以及顺序的部分乘法结果。初始值寄存器(104)存储预设的恒定偏置值。累加器(106)将每个部分相乘结果与恒定偏置值或先前的相加结果相加,并且执行移位操作以输出M位相乘结果。限制器(108)使M位乘法结果对应于输入数据的位数。输出寄存器(110)存储有限的乘法结果,在下一个乘法操作中对存储的有限的乘法结果执行自反馈,或者将乘法结果输入到其他相邻单元作为输入数据。

著录项

  • 公开/公告号KR100292067B1

    专利类型

  • 公开/公告日2001-03-19

    原文格式PDF

  • 申请/专利权人 DAEWOO ELECTRONICS CO. LTD.;

    申请/专利号KR19970074303

  • 发明设计人 PARK SEONG JUN;

    申请日1997-12-26

  • 分类号G06F7/52;

  • 国家 KR

  • 入库时间 2022-08-22 01:12:20

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