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FFT ARITHMETIC UNIT AND FFT ARITHMETIC METHOD

机译:FFT算术单位和FFT算术方法

摘要

PROBLEM TO BE SOLVED: To speed up an FFT arithmetic operation by allowing pipeline processing in respective FFT arithmetic stage units by avoiding access competi tion to the same bank.;SOLUTION: Respective memories 7 and 9 are divided into the i number of banks according to the data number i simultaneously inputted to a butterfly arithmetic operation part 21. The readout/write-in address of data to the respective banks is controlled by two address forming parts 11 and 13. When the memory 7 outputs the data to the butterfly arithmetic operation part 21 in a certain FFT arithmetic stage, the memory 9 stores an output result from the butterfly arithmetic operation part 21 via a swap means 23 and a selector 25, and while, when the memory 9 outputs the data to the butterfly arithmetic operation part 21, the memory 7 stores the output result from the butterfly arithmetic operation part 21 via the swap means 23 and the selector 25.;COPYRIGHT: (C)2003,JPO
机译:解决的问题:通过避免对同一存储体的访问竞争,允许在各个FFT运算级单元中进行流水线处理,从而加快FFT运算速度;解决方案:分别将存储器7和9划分为i个存储区数据编号i被同时输入到蝶形运算部分21。到各个存储体的数据的读出/写入地址由两个地址形成部分11和13控制。当存储器7将数据输出到蝶形运算部分时在某个FFT运算阶段中的部分21中,存储器9通过交换装置23和选择器25存储蝶形运算部分21的输出结果,同时,当存储器9将数据输出到蝶形运算部分21时,存储器9 ,存储器7通过转换装置23和选择器25存储蝶形运算部分21的输出结果。COPYRIGHT:(C)2003,JPO

著录项

  • 公开/公告号JP2003150576A

    专利类型

  • 公开/公告日2003-05-23

    原文格式PDF

  • 申请/专利权人 MATSUSHITA ELECTRIC IND CO LTD;

    申请/专利号JP20010351055

  • 发明设计人 IKEDA TETSUYA;

    申请日2001-11-16

  • 分类号G06F17/14;

  • 国家 JP

  • 入库时间 2022-08-22 00:16:15

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