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DSP USING MULTI-SEGMENTED BUSES EQUIPPED WITH PLURAL PROCESSORS PERFORMING FFT, AND METHOD THEREOF

机译:使用装有执行FFT的复数处理器的多段总线的DSP及其方法

摘要

PURPOSE: A DSP(Digital Signal Processor) using multi-segmented buses and a method thereof are provided to perform the IPC(Inter-Processor Communication) at the same time by using the buses of a small size. CONSTITUTION: The processors perform the FFT(Fast Fourier Transform). The DSP performs the IPC at the same time by using processors as an intersecting point and respectively matching at least more than two buses with the processors. The buses are equipped with the first buses respectively connecting the processors of a predetermined unit among the processors, and the second buses respectively connecting the processors connected through the respective first buses to the first buses in a lattice shape.
机译:目的:提供一种使用多段总线的DSP(数字信号处理器)及其方法,以通过使用小尺寸的总线同时执行IPC(处理器间通信)。组成:处理器执行FFT(快速傅立叶变换)。 DSP通过使用处理器作为相交点并分别将至少两个以上的总线与处理器相匹配,来同时执行IPC。总线配备有分别将处理器中的预定单元的处理器连接的第一总线,以及分别将通过各个第一总线连接到第一总线的处理器以格子状连接的第二总线。

著录项

  • 公开/公告号KR20040084098A

    专利类型

  • 公开/公告日2004-10-06

    原文格式PDF

  • 申请/专利权人 MAGNACHIP SEMICONDUCTOR LTD.;

    申请/专利号KR20030018923

  • 发明设计人 LIM YEONG WON;

    申请日2003-03-26

  • 分类号G06F13/38;

  • 国家 KR

  • 入库时间 2022-08-21 22:47:55

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