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Recursive calculation circuit for path metric values in Viterbi decoder, has two's complement arithmetic circuit for performing compare operations

机译:维特比解码器中路径度量值的递归计算电路,具有用于执行比较操作的二进制补码运算电路

摘要

A branch metric unit (BMU) circuit calculates branch metric values, which are normalized so that one of the branch metric values is set to zero. An add-compare-select unit (ACSU) updates the path metric values using ACS operations and the calculated branch metric values. At least the part of the circuit (ACSU) that performs ACS operates using the branch metric value normalized to zero has a two's complement arithmetic circuit (21,23) for compare operations. An Independent claim is included for a method of recursively calculating path metric values.
机译:分支度量单位(BMU)电路计算分支度量值,将其标准化以使分支度量值之一设置为零。加比较选择单元(ACSU)使用ACS操作和计算出的分支度量值来更新路径度量值。使用归一化为零的分支度量值的至少一部分执行ACS的电路(ACSU)具有用于比较操作的二进制补码运算电路(21,23)。包含独立声明,用于递归计算路径度量值。

著录项

  • 公开/公告号DE10300268A1

    专利类型

  • 公开/公告日2004-07-22

    原文格式PDF

  • 申请/专利权人 INFINEON TECHNOLOGIES AG;

    申请/专利号DE2003100268

  • 发明设计人 STEINERT MARIO;

    申请日2003-01-08

  • 分类号H03M13/41;

  • 国家 DE

  • 入库时间 2022-08-21 22:43:32

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