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Apparatus and method for self testing programmable logic arrays

机译:用于自测试可编程逻辑阵列的设备和方法

摘要

A self-testing programmable logic array PLA system has an array of programmably interconnected logic cells, a built-in self-test (BIST) structure interconnected with the logic cells, and a BIST engine having an initiation input. The system is characterized in that, upon receiving the initiation input, the BIST engine drives the BIST structure to test connections and functions of the PLA. BIST systems are taught for stand-alone programmable logic arrays (PLAs) and for PLAs embedded in System-on-a-Chip (SoC) devices.
机译:自检可编程逻辑阵列PLA系统具有一组可编程互连的逻辑单元,与逻辑单元互连的内置自检(BIST)结构以及具有启动输入的BIST引擎。该系统的特征在于,在接收到启动输入后,BIST引擎将驱动BIST结构以测试PLA的连接和功能。针对独立可编程逻辑阵列(PLA)和嵌入式系统级芯片(SoC)器件中的PLA讲授了BIST系统。

著录项

  • 公开/公告号US2005039098A1

    专利类型

  • 公开/公告日2005-02-17

    原文格式PDF

  • 申请/专利权人 RAFAEL C. CAMAROTA;

    申请/专利号US20040947811

  • 发明设计人 RAFAEL C. CAMAROTA;

    申请日2004-09-22

  • 分类号G01R31/28;

  • 国家 US

  • 入库时间 2022-08-21 22:23:11

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