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Method and apparatus for accounting for delays caused by logic in a network interface by integrating logic into a media access controller

机译:通过将逻辑集成到媒体访问控制器中来解决由网络接口​​中的逻辑引起的延迟的方法和装置

摘要

A method and apparatus for reducing link latency caused by logic in a network interface. A media access controller having a converter, modification logic, a FIFO and a controller reduces the link latency caused when the logic modifies a data packet. The converter receives frame data from a transmit buffer and converts the frame data into a data packet having a prescribed format for transmission onto a network. The logic modifies the data packet. The FIFO buffers the data packet using a plurality of flip-flops. The controller controls the flow of the data packet and determines when to transmit the data packet onto a network via a media access controller.
机译:一种用于减少由网络接口​​中的逻辑引起的链路等待时间的方法和装置。具有转换器,修改逻辑,FIFO和控制器的媒体访问控制器减少了逻辑修改数据分组时引起的链路等待时间。转换器从发送缓冲器接收帧数据,并将帧数据转换成具有规定格式的数据包,以传输到网络上。逻辑修改数据包。 FIFO使用多个触发器来缓冲数据分组。控制器控制数据包的流,并确定何时通过媒体访问控制器将数据包传输到网络上。

著录项

  • 公开/公告号US6822968B1

    专利类型

  • 公开/公告日2004-11-23

    原文格式PDF

  • 申请/专利权人 ADVANCED MICRO DEVICES INC.;

    申请/专利号US20000536724

  • 发明设计人 ALVIN SWEE HOCK LIM;

    申请日2000-03-28

  • 分类号H04L125/60;

  • 国家 US

  • 入库时间 2022-08-21 22:20:20

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