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LUT-based logic element with support for Shannon decomposition and associated method

机译:支持Shannon分解的基于LUT的逻辑元素及相关方法

摘要

A logic circuit comprising: a plurality of logic elements; wherein at least one logic element includes, first and second LUT blocks that includes an output; an output multiplexer that includes first and second inputs, an output, and that includes a control output; a control input multiplexer circuit including a control input and including first and second data inputs that can be configured to receive first and second data outputs provided by one or more other logic elements of the plurality of logic elements and that includes a data output that can be connected to the control input of the output multiplexer; and multiple control inputs that can be shared by the first and second LUT blocks.
机译:一种逻辑电路,包括:多个逻辑元件;和其中,至少一个逻辑元件包括第一和第二LUT块,该第一和第二LUT块包括输出;输出多路复用器,其包括第一和第二输入,输出以及包括控制输出;控制输入​​多路复用器电路,包括控制输入,并且包括第一和第二数据输入,其可以被配置为接收由多个逻辑元件中的一个或多个其他逻辑元件提供的第一和第二数据输出,并且包括可以是连接到输出多路复用器的控制输入;以及第一和第二LUT块可以共享的多个控制输入。

著录项

  • 公开/公告号US7030652B1

    专利类型

  • 公开/公告日2006-04-18

    原文格式PDF

  • 申请/专利权人 DAVID LEWIS;JAMES SCHLEICHER;

    申请/专利号US20040830819

  • 发明设计人 DAVID LEWIS;JAMES SCHLEICHER;

    申请日2004-04-23

  • 分类号H03K19/177;

  • 国家 US

  • 入库时间 2022-08-21 21:43:34

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