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Semiconductor integrated circuit including delay line of delay locked loop and method of controlling delay time using the same

机译:包括延迟锁定环的延迟线的半导体集成电路以及使用该集成电路控制延迟时间的方法

摘要

A semiconductor integrated circuit includes a delay line of a delay locked loop. The delay line of the delay locked loop includes a delay variation detecting unit that outputs a detection signal according to a variation in delay time using a reference clock signal, and a plurality of delay units that change a delay time according to the detection signal and delay the output of an input signal by the changed delay time.
机译:半导体集成电路包括延迟锁定环的延迟线。延迟锁定环的延迟线包括:延迟变化检测单元,其使用参考时钟信号根据延迟时间的变化来输出检测信号;以及多个延迟单元,其根据检测信号和延迟来改变延迟时间。通过改变的延迟时间输出输入信号。

著录项

  • 公开/公告号US7944258B2

    专利类型

  • 公开/公告日2011-05-17

    原文格式PDF

  • 申请/专利权人 YOUNG-HOON OH;

    申请/专利号US20060647467

  • 发明设计人 YOUNG-HOON OH;

    申请日2006-12-29

  • 分类号H03L7/06;

  • 国家 US

  • 入库时间 2022-08-21 18:11:32

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