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Packet processor, packet control method, and packet control program

机译:分组处理器,分组控制方法和分组控制程序

摘要

A packet processor having one or two or more packet processing units is provided with a packet detector which detects whether or not a packet exists in a packet processing unit, and outputs a packet detection signal indicating a result of the detection, and a clock frequency controller which controls a clock to be supplied to the packet processing unit based on the packet detection signal.
机译:具有一个或两个以上分组处理单元的分组处理器设置有分组检测器和时钟频率控制器,该分组检测器检测分组处理单元中是否存在分组,并输出指示检测结果的分组检测信号。它根据分组检测信号控制要提供给分组处理单元的时钟。

著录项

  • 公开/公告号US8005078B2

    专利类型

  • 公开/公告日2011-08-23

    原文格式PDF

  • 申请/专利权人 HIDENORI HISAMATSU;

    申请/专利号US20090465058

  • 发明设计人 HIDENORI HISAMATSU;

    申请日2009-05-13

  • 分类号H04Q11;

  • 国家 US

  • 入库时间 2022-08-21 18:11:01

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