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Efficient clocking scheme for a bidirectional data link

机译:双向数据链路的高效时钟方案

摘要

A method for communication via a bidirectional data link between a processing device and a memory device. The memory device includes a clock source to generate a clock signal for driving a latching at the memory device of data to and/or from the bidirectional data link. The memory device provides the clock signal to the processing device for driving a latching at the processing device of data to and/or from the bidirectional data link.
机译:一种用于经由处理设备与存储设备之间的双向数据链路进行通信的方法。该存储设备包括时钟源,该时钟源产生时钟信号以驱动去往和/或来自双向数据链路的数据在存储设备上的锁存。存储器设备向处理设备提供时钟信号,以驱动去往和/或来自双向数据链路的数据在处理设备上的锁存。

著录项

  • 公开/公告号US8321719B2

    专利类型

  • 公开/公告日2012-11-27

    原文格式PDF

  • 申请/专利权人 ANDRE SCHAEFER;

    申请/专利号US20090567701

  • 发明设计人 ANDRE SCHAEFER;

    申请日2009-09-25

  • 分类号G06F1/04;G06F1/12;G06F5/06;

  • 国家 US

  • 入库时间 2022-08-21 16:42:55

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