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ALL-DIGITAL PHASE-LOCKED LOOP FOR ADAPTIVELY CONTROLLING A CLOSED-LOOP BANDWIDTH, METHOD THEREOF, AND DEVICES HAVING THE SAME

机译:全数字锁相环,用于自适应地控制闭环带宽,其方法和具有相同功能的设备

摘要

An operation method of an all-digital phase-locked loop (ADPLL) includes a step of detecting a phase change of a feedback signal of the ADPLL by using a search window and a step of controlling a closed-loop bandwidth of the ADPLL based on a detected result. A closed-loop bandwidth when the phase change is detected outside of the search window is greater than a closed-loop bandwidth when the phase change is detected within the search window.
机译:全数字锁相环(ADPLL)的操作方法包括以下步骤:通过使用搜索窗口来检测ADPLL的反馈信号的相位变化;以及基于该锁相环来控制ADPLL的闭环带宽的步骤。检测结果。当在搜索窗口外部检测到相位变化时的闭环带宽大于在搜索窗口内部检测到相位变化时的闭环带宽。

著录项

  • 公开/公告号KR20140112244A

    专利类型

  • 公开/公告日2014-09-23

    原文格式PDF

  • 申请/专利权人 SAMSUNG ELECTRONICS CO. LTD.;

    申请/专利号KR20130026740

  • 发明设计人 PARK JAE JIN;JANG TAE KWANG;XINGNAN;

    申请日2013-03-13

  • 分类号H03L7/08;H03L7/087;

  • 国家 KR

  • 入库时间 2022-08-21 15:42:06

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