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INVERTED-T SHAPED VIA FOR REDUCING ADVERSE STRESS-MIGRATION EFFECTS

机译:倒T形用于减少不良应力迁移效应

摘要

A semiconductor interconnect structure is formed as a via with an inverted-T shape to increase the reliability of the interface between the interconnect structure and an underlying electrically conductive, e.g., copper (Cu), layer of material. The inverted-T shape effectively increases a bottom critical dimension of the via, thereby reducing and/or eliminating via degradation of the interconnect structure caused by voids in the electrically conductive layer introduced during high-temperature or stress-migration baking.
机译:半导体互连结构形成为具有倒T形的通孔,以提高互连结构与下面的导电材料(例如,铜(Cu))层之间的界面的可靠性。倒T形有效地增加了通孔的底部临界尺寸,从而减少和/或消除了由在高温或应力迁移烘烤期间引入的导电层中的空隙引起的互连结构的通孔退化。

著录项

  • 公开/公告号US2016027729A1

    专利类型

  • 公开/公告日2016-01-28

    原文格式PDF

  • 申请/专利权人 MACRONIX INTERNATIONAL CO. LTD.;

    申请/专利号US201414341351

  • 发明设计人 SHIH-PING HONG;YEN-LU CHEN;TA HUNG YANG;

    申请日2014-07-25

  • 分类号H01L23/522;H01L21/02;H01L21/311;H01L21/768;H01L23/528;H01L23/532;

  • 国家 US

  • 入库时间 2022-08-21 14:33:51

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