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Digital fractional-N PLL based upon ring oscillator delta-sigma frequency conversion

机译:基于环形振荡器delta-sigma频率转换的数字小数N分频PLL

摘要

A frequency-to-digital-converter based PLL (FDC-PLL) that implements the functionality of a charge pump and analog-to-digital converter (ADC) with a dual-mode ring oscillator (DMRO) and digital logic. Preferred embodiments of the invention include circuit-level techniques that provide better spurious tone performance and very low phase noise with lower power dissipation and supply voltage than prior digital PLLs known to the inventors.
机译:一种基于频率数字转换器的PLL(FDC-PLL),它实现了电荷泵和具有双模式环形振荡器(DMRO)和数字逻辑的模数转换器(ADC)的功能。本发明的优选实施例包括电路级技术,该电路级技术提供了比发明人已知的现有数字PLL更好的伪音性能和非常低的相位噪声,同时具有更低的功耗和电源电压。

著录项

  • 公开/公告号US10158366B2

    专利类型

  • 公开/公告日2018-12-18

    原文格式PDF

  • 申请/专利权人 THE REGENTS OF THE UNIVERSITY OF CALIFORNIA;

    申请/专利号US201615052578

  • 发明设计人 COLIN WELTIN-WU;IAN GALTON;

    申请日2016-02-24

  • 分类号H04L7/033;H04L7/00;H03L7/093;H03L7/099;H03L7/089;H03L7/091;H03L7/085;H03L7/183;

  • 国家 US

  • 入库时间 2022-08-21 12:13:51

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