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ADDER-SUBTRACTOR CIRCUIT AND METHOD OF CONTROLLING ADDER-SUBTRACTOR CIRCUIT

机译:加减电路和控制加减电路的方法

摘要

An adder-subtractor circuit includes an inverting circuit configured to invert a first operand on a bit-by-bit basis to output a first inverted operand, a circuit having a function to perform a predetermined arithmetic operation and configured to output a second operand, a carry generating circuit configured to generate carries from the first inverted operand and the second operand, and an XOR circuit configured to perform a bit-by-bit XOR on the carries, the first operand, and the second operand.
机译:加法器-减法器电路包括:反相电路,被配置为逐比特地对第一操作数进行反相以输出第一反相操作数;电路,其具有执行预定算术运算的功能并且被配置为输出第二操作数;以及进位生成电路,配置为从第一反操作数和第二操作数生成进位,以及XOR电路,配置为对进位,第一操作数和第二操作数进行逐位XOR。

著录项

  • 公开/公告号US2019339940A1

    专利类型

  • 公开/公告日2019-11-07

    原文格式PDF

  • 申请/专利权人 FUJITSU LIMITED;

    申请/专利号US201916392775

  • 发明设计人 SHIRO KAMOSHIDA;

    申请日2019-04-24

  • 分类号G06F7/503;G06F7/575;G06F7/505;

  • 国家 US

  • 入库时间 2022-08-21 12:07:58

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