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store_buffer merge的实现方法及系统

摘要

本发明涉及CPU技术领域,具体涉及一种store_buffer merge的实现方法及系统,包括store_buffer模块、pipeline模块、miss queue模块和refill模块。本发明对store数据提供一个时间窗口给后面的同一cacheline的store指令来merge,从而充分利用pipeline资源,把更多的pipeline资源给其他请求使用。从而提供CPU的整体性能。在store buffer entry项快用完的时候强制地让store buffer的entry项上Pipeline,而不再等待更年轻的store来merge;一个store buffer entry项被分配后,在一定的cycle数后,强制地让store buffer的entry项上Pipeline,而不再等待更年轻的store来merge,进而提供了CPU的整体性能。

著录项

  • 公开/公告号CN114217855A

    专利类型发明专利

  • 公开/公告日2022-03-22

    原文格式PDF

  • 申请/专利权人 广东赛昉科技有限公司;

    申请/专利号CN202111549628.3

  • 发明设计人 李长林;刘磊;

    申请日2021-12-17

  • 分类号G06F9/30(20060101);

  • 代理机构31312 上海邦德专利代理事务所(普通合伙);

  • 代理人刘旭章

  • 地址 528300 广东省佛山市顺德区大良街道云路社区昊阳路2号A区S201室

  • 入库时间 2023-06-19 14:36:00

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2022-03-22

    公开

    发明专利申请公布

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