用于形成导电材料的方法、用于选择性地形成导电材料的方法、用于形成铂的方法及用于形成导电结构的方法

摘要

本发明揭示选择性地形成导电材料的方法及形成金属导电结构的方法。可图案化有机材料以暴露下伏材料的若干区域。可将所述下伏材料暴露于前驱物气体(例如，铂前驱物气体)，所述前驱物气体与所述下伏材料反应而不与所述有机材料的位于所述下伏材料上方的剩余部分反应。可在原子层沉积过程中使用所述前驱物气体，在所述过程期间所述前驱物气体可选择性地与所述下伏材料反应以形成导电结构，但不与所述有机材料反应。举例来说，可在半导体装置制造的各种阶段期间将所述导电结构用作掩模来进行图案化。

说明书

技术领域

在各种实施例中，本发明大体来说涉及用于选择性地形成导电材料(例如，铂)的方法、用于形成导电材料的方法及形成导电结构的方法。

本申请案主张2008年11月19日提出申请的“用于形成导电材料的方法、用于选择性地形成导电材料的方法、用于形成铂的方法及用于形成导电结构的方法(Methods for Forming a Conductive Material，Methods for Selectively Forming a Conductive Material，Methods for Forming Platinum，and Methods for Forming Conductive Structures)”的序列号为12/274,169的美国专利申请案的申请日期的权益。

背景技术

在集成电路的制造中，使用各种导电层。举例来说，在半导体装置(例如，动态随机存取存储器(DRAM)、静态随机存取存储器(SRAM)、铁电(FE)存储器及NAND)的形成期间，导电材料用于存储单元电容器的形成中以及互连结构及导电线中。因此，导电材料的形成是集成电路(IC)制作中的重要制造过程。

形成导电材料的要求可以是苛刻的，这是因为需要在用于集成电路中的其它材料所耐受的相当低的温度下沉积导电膜。另外，导电材料的高质量保形膜通常用于覆盖集成电路上的高度变化的形貌以形成各种导电结构，例如开口、深沟槽及容器电容器开口。此外，需要以高生产量形成此类膜。

举例来说，常规存储单元包含两个导电电极及插入于其之间的电介质材料，且通常称为“金属-绝缘体-金属(MIM)”存储单元电容器。各种导电材料的一个或一个以上层可用于形成导电电极。随着电容器大小的减小，所述电介质材料的厚度必须减小以增加栅极电容。减小常规电介质材料(例如，二氧化硅)的厚度可导致增加的泄漏电流及装置的降低的可靠性。在所述两个导电电极之间利用高电介质常数材料在无伴随泄漏影响的情况下实现增加的栅极电容。已提议将导电材料(例如，铂、铑、铱、锇及其合金)用于此类MIM存储单元电容器。

制造许多存储单元电容器，其包含在小的高纵横比开口内由导电材料形成的电极层。术语“纵横比”是指集成电路的结构的深度或高度相对于其宽度。最常将铂用作导电材料，这是因为铂是通常减少单元中的泄漏的高功函数金属。然而，移除铂的实际蚀刻过程的缺失在电容器制造期间造成若干问题。用于形成铂电极的常规技术包含沉积铂，随后是CMP(化学机械抛光)或离子碾磨以移除所述铂的无关部分。然而，这些技术可导致铂电极中的不期望的缺陷。

参考图1A到图1C，图解说明在衬底102上形成包含容器型单元电容器的半导体结构100的常规方法。如图1A中所展示，衬底102可包含形成于其中的触点104且视情况可与下伏互连结构(未展示)接触。电介质材料106可形成于触点104及衬底102上方且可由例如二氧化硅(SiO₂)等材料形成。掩模材料108形成于电介质材料106上方并与其接触且经图案化以形成孔口(未展示)，从而暴露电介质材料106的期望在其处形成电容器结构的区域。可使用相对于掩模材料108选择性地移除电介质材料106的蚀刻过程来形成开口110。

此后，如图1B中所展示，在开口110内及在电介质材料106的上表面上形成待用于形成单元电容器的底部电极的导电材料112。然后，可将氧化物材料114施加于半导体结构100上方。然后，可平面化或蚀刻氧化物材料114及导电材料112的上覆于电介质材料106的水平部分以形成底部电极116。理想地，底部电极116的上部表面与电介质材料106的上部表面共面。

然而，在平面化期间，可将导电材料112推动到开口110的中心中，从而产生变形118，如图1C中所展示。导电材料112中的变形118产生不期望的轮廓，其妨碍在半导体结构100上的额外材料的形成。在导电材料112暴露于蚀刻过程以形成底部电极116时出现进一步的问题。在蚀刻期间，光致抗蚀剂材料120形成于导电材料112上方且经图案化以暴露导电材料112的待蚀刻的区域。在将导电材料112回蚀到电介质材料106后，光致抗蚀剂层120可即刻拉回而远离导电材料112，从而导致导电材料112的表面区域122被不期望地蚀刻。

为实现较高密度的存储器阵列，需要用于形成适于制造具有所需经增强密度及可靠性的复杂装置的导电材料及结构以满足未来需求的方法。

附图说明

图1A到图1C是图解说明在半导体结构上形成底部电极的常规方法的部分横截面图；

图2A到图2E是图解说明可用于在半导体结构上制造导电材料的方法的实施例的部分横截面图；及

图3是图解说明用于在半导体装置中形成接触孔的方法的实施例的部分横截面图。

具体实施方式

如下文进一步详细地论述，在一些实施例中，本发明包含用于选择性地形成导电材料(例如，铂)的方法。可相对于有机材料在衬底及绝缘材料中的至少一者上选择性地形成所述导电材料。可使用通过使期望在其上形成所述导电材料的表面与前驱物气体反应同时所述表面的剩余区域由所述有机材料(例如，光致抗蚀剂材料)保护而进行的原子层沉积过程来形成所述导电材料。在额外实施例中，本发明包括用于通过将有机材料施加于上覆于衬底的绝缘材料上方来形成导电结构的方法。形成延伸穿过所述有机材料及所述绝缘材料的至少一个开口以暴露所述衬底。使所述绝缘材料及衬底经受前驱物气体，所述前驱物气体选择性地与所述绝缘材料及衬底反应以在其上形成至少一种导电材料而不与所述有机材料反应。在所述至少一种导电材料上方形成电介质材料且在所述电介质材料上方形成另一导电材料，从而产生至少一个电容器结构。

如本文中所使用，术语“衬底”意指且包含在其上形成额外材料的基底材料或构造。所述衬底可以是半导体衬底、位于支撑结构上的基底半导体层、金属电极或其上形成有一个或一个以上层、结构或区域的半导体衬底。所述衬底可以是常规硅衬底或包括半导电材料层的其它体衬底。如本文中所使用，术语“体衬底”不仅意指并包含硅晶片，而且意指并包含绝缘体上硅(“SOI”)衬底(例如，蓝宝石上硅(“SOS”)衬底及玻璃上硅(“SOG”)衬底)、位于基底半导体基础上的外延硅层，及其它半导体或光电材料(例如，硅-锗、锗、砷化镓、氮化镓及磷化铟)。所述衬底可以是经掺杂或未经掺杂的。

以下描述提供特定细节(例如，材料类型、材料厚度及处理条件)以提供对本发明实施例的透彻描述。然而，所属领域的技术人员应理解，可在不采用这些特定细节的情况下实践本发明的实施例。实际上，本发明的实施例可结合业界中所采用的常规半导体制造技术来实践。另外，下文提供的描述并不形成用于制造其中存在导电结构的半导体装置的完整过程流程，且下文所述的半导体装置并不形成完整电子装置。下文仅详细描述为理解本发明的实施例所必需的那些过程动作及导电结构或半导体装置。由所述导电结构形成完整半导体装置或由所述半导体装置形成完整电子装置的额外处理动作可通过本文中未描述的常规制造技术来执行。

本文所述的材料可通过任一适合技术形成，包含(但不限于)旋涂、毯覆式涂覆、化学气相沉积(“CVD”)、原子层沉积(“ALD”)、等离子体增强型ALD或物理气相沉积(“PVD”)。另一选择为，可原位生长所述材料。端视待形成的特定材料，所属领域的技术人员可选择用于沉积或生长材料的技术。此外，尽管本文所描述及图解说明的材料可形成为若干层，但所述材料并不限于此且可形成为其它三维配置。

现将参考图式，其中相同编号表示相同元件。所述图式不必按比例绘制。

图2A到图2E是图解说明形成半导体结构200的方法的部分横截面示意图。半导体结构200可包含其中形成有触点204的衬底202、可选势垒材料、绝缘材料208及有机材料210。如先前所论述，衬底202可以是半导体材料或例如玻璃或蓝宝石等材料的全部或部分晶片。可使用常规图案化及沉积方法(本文中未详细描述)在衬底202中由导电材料(例如，多晶硅)形成触点204。以非限制性实例的方式，触点204可由导电材料(例如，多晶硅、氮化钛、铑、钌、铱或其组合)形成，且可用于将金属-绝缘体-金属(MIM)存储电容器电耦合到一个或一个以上相关联晶体管装置或导电线，其将在下文中详细描述。

所述势垒材料(未展示)(如果存在)可形成于衬底202及触点204的表面上方并与其接触。所述势垒材料可包含(举例来说)氮化物材料，例如，氮化钛(TiN)、氮化钽(TaN)或氮化钽硅(TaSiN)。另外，所述势垒材料可包含氧势垒材料(未展示)，其包含(举例来说)氧化铑、铱或掺杂有二氧化硅的金属。

绝缘材料208可形成于衬底202、触点204及所述势垒材料上方且与其接触(如果存在)。以非限制性实例的方式，绝缘材料208可由二氧化硅、磷硅酸盐玻璃(PSG)、硼硅酸盐玻璃(BSG)及硼磷硅酸盐玻璃(BPSG)形成。

有机材料210可形成于绝缘材料208上方并与其接触且可包含(举例来说)聚合物材料。有机材料210可以是防止导电材料在其上成核及生长的材料。以非限制性实例的方式，有机材料210可以是包含基于重氮萘醌的材料、基于聚羟基苯乙烯的材料、基于苯酚甲醛树脂的材料或基于环氧树脂的材料的光致抗蚀剂材料。另外，有机材料210可包含聚合物，例如，聚苯乙烯(PS)、聚乙烯(PE)、聚丙烯(PP)、聚氯丁二烯(CR)、聚乙烯醚、聚(乙酸乙烯酯)(PVAc)、聚(氯乙烯)(PVC)、聚硅氧烷、聚(甲基丙烯酸甲酯)(PMMA)、聚氨酯(PU)、聚丙烯酸酯、聚丙烯酰胺、酚醛树脂、聚甲基戊二酰亚胺(PMGI)、聚甲基硅烷(PMS)、非芳族聚合物、聚甲基戊二酰亚胺以及其共聚物及混合物。可通过任一适合技术(例如，旋转浇铸、旋涂、喷镀、墨涂或浸涂)来将有机材料210施加于绝缘材料208上方。可形成有机材料210以防止导电材料在其上的沉积，此将在下文中进一步详细描述。作为非限制性实例，有机材料210可以是由不包含羟基的聚合物材料形成且可形成为大于所述聚合物材料的一个单层的平均厚度的厚度。有机材料210中可包含孔口212，所述孔口暴露绝缘材料208的表面。可通过使用常规技术(本文中未详细描述)图案化有机材料210来形成孔口212。

仍参考图2A，可通过移除绝缘材料208的通过有机材料210中的孔口212暴露的至少一部分来在半导体结构200中形成开口214(以虚线展示)。如果开口214延伸穿过绝缘材料208，那么开口214可由衬底202及触点204的上部表面216以及绝缘材料208的侧壁218来界定。如果开口214部分地延伸到绝缘材料208中，那么开口214可由绝缘材料208的剩余部分的上部表面及绝缘材料208的侧壁218来界定。以非限制性实例的方式，开口214可形成为杯状容器(如图2A中的虚线所展示)，且可具有各种横截面形状，例如，圆形、正方形、矩形、梯形、三角形、椭圆形或长菱形。举例来说，开口214可经形成以具有小于约50nm的特征大小或临界尺寸且可具有大于约40∶1的纵横比。

在一个实施例中，所述势垒材料(如果存在)是氮化钛，绝缘材料208是二氧化硅，且有机材料210是包含苯酚甲醛聚合物与双叠氮萘醌的混合物的光致抗蚀剂材料。可使用含氟蚀刻剂(例如，包含氢氟酸的溶液或包含四氟甲烷(CF₄)或六氟丁二烯(C₄F₆)的等离子体)来在不移除所述势垒材料(如果存在)或有机材料210的情况下移除绝缘材料208且形成开口214。为清晰起见，以下图式中所绘示的半导体结构200包含单个开口214，所述单个开口延伸穿过绝缘材料208的厚度到达所述势垒材料(如果存在)，或另一选择为，到达衬底202及触点204。然而，在其它实施例中，可在半导体结构200中形成多个开口214。另外，开口214可延伸到任何下伏材料中，例如势垒材料或衬底202。开口214可经定位以促进触点204与额外结构之间的接近，所述额外结构可包含导电区域(例如，晶体管或导电线)，其将在下文中进一步详细描述。

在移除绝缘材料208的一部分以形成开口214之后，可清洁由开口214暴露的表面。为清洁经暴露表面，可将半导体结构200暴露于移除残余物(例如，有机残余物)的蚀刻过程且在大致不移除有机材料210的情况下大致整平绝缘材料208及衬底202的表面上的粗糙。举例来说，可使用湿式蚀刻过程(使用含氟化氢(HF)的溶液)或干式蚀刻过程(使用包含臭氧(O₃)的等离子体)。作为非限制性实例，可将以约100∶1的比率包含氟化氢及氟化铵(NH₄F)的混合物的溶液施加到由开口214暴露的表面达约1分钟以清洁其表面。清洁半导体结构200可从开口214内的绝缘材料208的侧壁218及势垒材料(如果存在)或触点204以及衬底202的上部表面216移除聚合物、有机材料及其它残余物。如将进一步详细描述，这些残余物的移除可促进材料(例如，铂)的沉积。

参考图2B，在清洁半导体结构200之后，导电材料220可形成于绝缘材料208的侧壁218以及衬底202及触点204或势垒材料(如果存在)的上部表面216上，而不形成于半导体结构200的由有机材料210保护的表面222上。可使用ALD过程来保形地沉积导电材料220。举例来说，可通过将半导体结构200暴露于前驱物气体来执行ALD过程，所述前驱物气体与绝缘材料208、衬底202或势垒材料(如果存在)反应，但不与有机材料210反应。通过利用ALD过程，可一次形成导电材料220的单个单层。在所述ALD过程期间，通过经暴露表面与所述前驱物气体之间的自限制性表面反应来控制导电材料220的生长。所述ALD过程实现导电材料220的一个或一个以上单层的受控沉积。可在足够低的温度下执行通过ALD形成导电材料220以使得有机材料210保持完整且不受损坏或降级。因而，有机材料210可用作掩模以保护绝缘材料208的下伏区域。不受限于任何特定理论，据信有机材料210可防止绝缘材料208的表面222与前驱物气体之间发生反应，此防止在ALD过程期间导电材料220在表面222上的成核及生长。

导电材料220可以是(举例来说)铂、钛、钽、铱、铑、钌、铜、其氧化物或氮化物、其组合或其合金。适于产生这些导电材料的ALD前驱物气体为此项技术中所熟知，且因此本文中未对其进行详细描述。作为非限制性实例，可将导电材料220沉积为从约到约的范围内的厚度。为简单起见，将导电材料220绘示为包含单个层。然而，在一些实施例中，导电材料220可以是由多个层形成。为沉积导电材料220，可将半导体结构200暴露于反应室中的前驱物气体达充足时间量以形成导电材料220的所期望厚度。所述反应室可维持于从约50℃到约300℃的范围内的温度下且维持于从约0.0001托到约5托的范围内的恒定压力或可变压力下。

以非限制性实例的方式，如果铂是所期望导电材料220，那么前驱物气体可包含(但不限于)(三甲基)甲基环戊二烯铂(Pt10)、(三甲基)环戊二烯基(C₅H₅)Pt(CH₃)₃、Pt(乙酰基丙酮酸盐)2、Pt(PF₃)₄、Pt(CO)₂Cl₂、顺式-[Pt(CH₃)₂((CH₃)NC)₂]或六氟乙酰丙酮铂。前驱物气体可流动到开口214中以在不于由有机材料210覆盖的表面上形成铂的情况下于绝缘材料208、触点204、衬底202及势垒材料(如果存在)的经暴露表面上形成铂。换句话说，可在半导体结构200的经暴露表面上选择性地沉积铂，除有机材料210的经暴露表面以外。

通过使用有机材料210来防止将导电材料220沉积于半导体结构200的表面222上，导电材料220的表面224可经形成以在不使用额外平面化或蚀刻动作的情况下大致与绝缘材料208的表面222共面。由于导电材料220是大致无缺陷或变形，因此形成于半导体结构200上的额外材料可以是大致无缺陷。此外，通过以用于形成开口214(图2A)的相同有机材料210来保护绝缘材料208的表面222，不使用进一步处理动作来在半导体结构200的所期望位置上形成导电材料220。因此，本方法在不进行进一步遮蔽及蚀刻动作的情况下实现导电材料220的沉积，从而减少制造半导体结构200的时间及费用。

如所属领域的技术人员将认识到，尽管本文中将导电材料220图解说明为选择性地形成于半导体结构200中的开口214内，但可使用类似过程将导电材料200选择性地沉积于具有不同外形的各种其它表面及结构上。作为非限制性实例，导电材料220可形成于孔口212中(如图2A中所展示)，或导电材料220可形成于其部分由有机材料210保护的其它材料的经暴露表面上。

参考图2C，在形成导电材料220之后，可移除有机材料210的一部分以暴露绝缘材料208的期望在其处形成电容器结构的表面226。可通过使用常规图案化技术(例如，遮蔽及蚀刻)来移除有机材料210的所期望部分而暴露绝缘材料208的表面226。

如图2D中所展示，电介质材料228可施加于导电材料220及绝缘材料208的表面226上方且与其接触，此后另一导电材料230可施加于电介质材料228上方且与其接触以形成电容器结构232。作为非限制性实例，电介质材料228可以是具有高电介质常数的材料(例如，氧化钽、五氧化二钽(Ta₂O₅)、钛酸锶(SrTiO₃)、钛酸锶钡(BST)或氧氮化硅(SiON))，且可使用(举例来说，CVD或PVD)来形成。另一导电材料230可包含(举例来说)铂、钛、钽、铱、铑、钌、其氧化物或氮化物、其组合或其合金。可使用例如CVD或PVD的过程来形成另一导电材料230。为简单起见，将另一导电材料230绘示为包含单个层。然而，在一些实施例中，另一导电材料230可包含金属或其它导电材料的多个层。以非限制性实例的方式，另一导电材料230可以是铂且可相对于有机材料210的剩余部分选择性地形成于电介质材料228上，如先前所述。

参考图2E，在形成电容器结构232之后，形成有机材料210。作为非限制性实例，如果有机材料210是光致抗蚀剂材料，那么可使用常规灰化过程来在不使另一导电材料230或绝缘材料208损坏或降级的情况下移除所述光致抗蚀剂材料。另外，可使用各向同性蚀刻过程(例如，湿式化学蚀刻或部分地各向同性反应性离子蚀刻(RIE))来移除对于另一导电材料230具有选择性的绝缘材料208。举例来说，如果绝缘材料208包含二氧化硅且另一导电材料230包含铂，那么使用相对于二氧化硅选择性地移除铂的湿式蚀刻过程。

如图3中所展示，可提供包含多个电容器结构232作为邻近掩模结构242的半导体装置300。半导体装置300可包含上覆于衬底202的绝缘材料208、触点204及包含导电材料220、电介质材料228及另一导电材料230的电容器结构232，如图2D中所展示。另外，半导体装置300可包含相对于源极区域236、汲极区域238及场氧化物区域240而形成的晶体管装置234。可通过本文中未详细描述的常规技术来形成晶体管装置234。可执行各向异性干式反应性离子(即，等离子体)蚀刻过程或湿式化学蚀刻过程以相对于另一导电材料230及邻近掩模结构242移除绝缘材料208的一部分以暴露晶体管装置234的区域。绝缘材料208的经移除部分可形成接触孔244。邻近掩模结构242可各自包含通过上文参考图2A到图2D所描述的方法而形成的电容器结构232。在一些实施例中，晶体管装置234中的至少一者可与至少一个导电线(未展示)电连通。可通过本文中未详细描述的常规技术来形成所述导电线。

尽管可易于对本发明作出各种修改及替代形式，但特定实施例已以实例方式展示于图式中并已详细描述于本文中。然而，应理解，本发明并不限于所揭示的特定形式。而是，本发明涵盖归属于由以上所附权利要求书及其合法等效形式界定的本发明范围内的所有修改、变更及替代形式。