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机译:FPGAアレイを用いてTFlopsを目指したポアソン方程式演算回路の実装と評価
佐藤一輝; バートルスレン バルス; 関根優年;
東京農工大学 大学院 工学府 〒184-8588 東京都小金井市中町2-24-16 E-mail: {kazuki,bars}@sekine-lab.ei.tuat.ac.jp;
スケーラブル; Hw/sw複合体; ポアソン方程式;
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