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机译:基于快速FIR算法的并行FIR滤波器结构的硬件复杂度降低
Faculty of Electrical Engineering, Anna University, Chennai, India;
Department of EEE, RMK College of Engineering and Technology,Puduvoyal, Tiruvallur Dt., India;
Hardware complexity; symmetric coefficients; Finite Impulse Response (FIR); sub-filter; odd;
机译:基于快速FIR算法的并行FIR滤波器结构的硬件复杂度降低
机译:基于快速FIR算法的均匀长度区域有效并行FIR数字滤波器结构
机译:基于快速FIR算法的有效并行FIR数字滤波器结构
机译:基于迭代短卷积的硬件高效快并行灭滤器结构
机译:采用极值优化的线性相位FIR数字滤波器设计,降低了硬件复杂性。
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机译:基于快速FIR算法的并行FIR数字滤波器的复杂度降低技术