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一層型SGT,積層型SGTを用いたシステムLSIのパターン面積の比較検討

机译:使用单层SGT和堆叠式SGT的系统LSI模式区域的比较研究

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摘要

一層型SGT,積層型SGTを用いて設計したインバータ,NAND等の簡単な論理回路と,1ビッrnトフルアダーのパターン面積の比較を行った.積層型SGTの導人によりインバータ,NAND等のパターン面積rnは縮小し,その効果は人力数が少なく,チャネル幅が短いほど顕著になる.フルアダーでもパターン面積は縮小rnするが,回路方式により,縦幅,横幅の縮小効果が異なる.
机译:使用单层SGT和叠层SGT设计的简单逻辑电路(例如反相器和NAND)与1位全加器的图形区域进行了比较。通过堆叠的SGT的引导,减小了反相器,NAND等的图案区域rn,并且随着人力数量的减少和沟道宽度的缩短,效果变得更加显着。即使使用完整的加法器,图案面积也会减小rn,但是垂直和水平缩小效果会因电路方法而异。

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