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机译:Red-Pitaya内部PLL的相位噪声和频率稳定性
Ist Nazl Ric Metrol, Phys Metrol Div, I-10135 Turin, Italy;
Ist Nazl Ric Metrol, Phys Metrol Div, I-10135 Turin, Italy;
Univ Bourgogne & Franche Comte, Dept Time & Frequency, CNRS, ENSMM Site,FEMTO ST Inst, F-25044 Besancon, France;
Ist Nazl Ric Metrol, Phys Metrol Div, I-10135 Turin, Italy;
Ist Nazl Ric Metrol, Phys Metrol Div, I-10135 Turin, Italy|Univ Bourgogne & Franche Comte, Dept Time & Frequency, CNRS, ENSMM Site,FEMTO ST Inst, F-25044 Besancon, France;
Digital electronics; field-programmable gate array (FPGA); frequency stability; phase-locked loop (PLL); phase noise;
机译:数字PLL频率合成器中相位/频率检测器的相位噪声影响
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机译:低相位噪声CMOS PLL频率合成器的分析与设计。
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机译:red-pitaya内部PLL的相位噪声和频率稳定性