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机译:通过数据重用实现FPGA中并行数据访问的有效内存分区
State Key Laboratory of ASIC and Systems, School of Microelectronics, Fudan University, Shanghai, China;
State Key Laboratory of ASIC and Systems, School of Microelectronics, Fudan University, Shanghai, China;
State Key Laboratory of ASIC and Systems, School of Microelectronics, Fudan University, Shanghai, China;
Fudan University, Shanghai, China;
University of Alberta, Edmonton, AB, Canada;
Partitioning algorithms; System-on-chip; Random access memory; Arrays; Registers; Memory management; Field programmable gate arrays;
机译:通过数据重用实现多模式数据访问的有效内存分区方法
机译:将数据重用与数据级并行化相结合,以FPGA为目标的硬件编译:几何编程框架
机译:在数据并行程序中为耦合的下标生成有效的本地内存访问序列
机译:在多维数组中进行并行数据访问的有效内存分区
机译:在新兴的并行平台上支持涉及动态数据结构和不规则内存访问的应用程序。
机译:DeSyGNER数据访问元素:一种易于重用的组件用于构建数据兼容的多媒体程序。
机译:1将数据重用与数据级并行化相结合以实现针对FPGA的硬件编译:几何编程框架
机译:不规则问题的分布式内存编译方法 - 数据拷贝重用和运行时分区