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机译:片上系统的SystemC事务级模型的完整仿真范围
Verimag (CNRS, Grenoble INP, UJF), Centre equation, 2, avenue de Vignate, 38610 Gieres, France INRIA Grenoble-Rhne-Alpes, 655 avenue de l'Europe, 38330 Montbonnot Saint Martin, France;
Verimag (CNRS, Grenoble INP, UJF), Centre equation, 2, avenue de Vignate, 38610 Gieres, France;
STMicroelectronics, 12 rue Jules Horowitz, 38019 Grenoble, France;
system-on-a-chip; translational modeling; simulation; Scheduling; loose timing; runtime verification; dynamic partial order reduction; test coverage;
机译:基于进程间通信的基于开源ISS的MPSoC平台的SystemC事务级建模
机译:SystemC事务级模型的设计和验证
机译:使用SoC环境进行事务级模型的多核仿真
机译:使用SystemC进行传感器网络的事务级建模
机译:使用SystemC / SystemC-AMS和跨层协同仿真工具的混合信号SoC的系统/体系结构级设计和建模。
机译:分析SystemC设计:适用于各种应用的SystemC分析方法
机译:使用systemC 2.0的amBa总线架构的事务级模型