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【24h】

Asymmetry in broadside configuration

机译:侧面配置不对称

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摘要

The broadside-coupled layout in Figure 1 in-cludes two traces, A and B, that begin on the surface layer of the pc board. They then pass through layer 2 into a broadside-coupled stripline configuration on layers 3 and 4. The plane-stitching via X resides 4 mm from signal via Y. The return current for trace A (dotted line) therefore has to divert 4 mm out of its way to find the plane-stitching via, plus another 4 mm to get back, giving a total estimated additional delay of (4 mm)·2·(4 psec/mm)=56 psec. If this same asymmetry exists at both ends of the broadside configuration, the total additional delay on trace A equals 112 psec.
机译:图1中的宽边耦合布局包括从印制电路板表面层开始的两条走线A和B。然后,它们穿过第2层,进入第3层和第4层的宽边耦合带状线配置。通孔X的平面缝合距信号通孔Y约4毫米。因此,迹线A(虚线)的返回电流必须转移4毫米通过找到平面缝合的方式,再加上另外的4毫米来取回,估计总的额外延迟为(4毫米)·2·(4皮秒/毫米)= 56皮秒。如果在宽边配置的两端都存在相同的不对称性,则迹线A上的总附加延迟等于112皮秒。

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