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Single-Chip Clock Generator with 14-Channel Distribution Solves Timing Challenges in Networks

机译:具有14通道分配的单芯片时钟发生器解决了网络中的时序挑战

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摘要

Global demand for communication services continues to rise, and manufacturers must constantly reduce the size and cost of newly installed network equipment, while holding to high standards of service and quality. Part of building a robust network is managing clocks. Clock and timing requirements range from system-level synchronization of wired and wireless network hubs, to local signal distribution inside high density transceiver cabinets. To meet this wide array of design challenges, companies employ signal integrity experts to interpret specifications, oversee testing, and recommend components guaranteed to maintain clean, low jitter clocks throughout the network.
机译:全球对通信服务的需求持续增长,制造商必须在保持高标准的服务和质量的同时,不断减小新安装的网络设备的尺寸和成本。建立健壮的网络的一部分是管理时钟。时钟和定时要求的范围从有线和无线网络集线器的系统级同步到高密度收发器机柜内部的本地信号分配。为了应对各种各样的设计挑战,公司聘请信号完整性专家来解释规格,监督测试并推荐可保证在整个网络中保持干净,低抖动时钟的组件。

著录项

  • 来源
    《Electrical Design News》 |2006年第22期|p.33|共1页
  • 作者

    Scott Behrhorst;

  • 作者单位

    Analog Devices' Clock and Signal Synthesis product line;

  • 收录信息 美国《科学引文索引》(SCI);
  • 原文格式 PDF
  • 正文语种 eng
  • 中图分类 一般性问题;
  • 关键词

  • 入库时间 2022-08-18 00:35:39

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