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机译:统一建模语言伪影中集成计算树逻辑模型检查的方法:嵌入式控制器的案例研究
DRDO Naval Phys & Oceanog Lab Kochi 682021 Kerala India;
Cochin Univ Sci & Technol Fac Technol Kochi 682022 Kerala India;
Unified modelling language; State chart diagram; State chart matrix; Safety property specification; Computational tree logic; Formal verification;
机译:在统一建模语言伪像中集成计算树逻辑模型检查的方法论:嵌入式控制器的案例研究
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