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关于同步时序逻辑电路设计中'状态简化'方法的探索

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作者根据多年教学经验提出一种在同步时序逻辑电路的设计过程中"通过直接观察电路必须记忆的各个状态所产生的效果而合并状态"进行"状态简化"的方法.

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来源
《昌吉学院学报》 |2004年第1期|119-122|共4页
作者
徐兵;
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作者单位

昌吉学院物理系,新疆,昌吉,831100;

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正文语种 chi
中图分类物理学;
关键词
逻辑功能; 序列检测; 等价状态; 有效状态; 状态简化;

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