基于NIOS Ⅱ的视频叠加电路设计与实现

黄伟; 郭宝龙; 吴华兴; 党小宝

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基于NIOS Ⅱ的视频叠加电路设计与实现

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介绍基于NIOSⅡ嵌入式视频叠加电路的设计与实现.嵌入式NIOSⅡ CPU控制电路接收矢量视频信号及标准PAL制视频信号,使其相叠加后存储于双端口RAM,上位机通过PXI总线接口将双端口RAM中数字视频信号采集至内存,并通过软件将叠加后的视频信息回放.实验证明,该电路能有效完成视频叠加,并成功应用于某测试系统.

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来源
《电子设计工程》|2009年第4期|4-6|共3页
作者
黄伟; 郭宝龙; 吴华兴; 党小宝;
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作者单位

西安电子科技大学,机电工程学院,陕西,西安,710071;

西安电子科技大学,机电工程学院,陕西,西安,710071;

西安空军工程大学,工程学院,陕西,西安,710038;

西安电子科技大学,机电工程学院,陕西,西安,710071;

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原文格式 PDF
正文语种 chi
中图分类 TP335.3;
关键词
NIOSⅡ; 矢量视频; PAL; PXI;
入库时间 2022-08-18 02:59:19

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