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第1章 绪论
1.1 课题的背景
1.2 研究的目的和意义
1.3 本文的组织结构
第2章 可重构计算技术基础及概述
2.1 可重构发展历史
2.2 可重构技术定义
2.3 现场可编程逻辑阵列FPGA简述
2.3.1 FPGA内部逻辑结构
2.3.2 可重构逻辑器件的分类
2.3.3 可重构逻辑器件的编程原理
2.4 FPGA的配置原理
2.4.1 配置模式
2.4.2 配置流程
2.4.3 配置数据结构
第3章 动态可重构系统相关技术研究
3.1 静态可重构系统和动态可重构系统
3.1.1 静态可重构系统
3.1.2 动态可重构系统
3.2 局部动态重构技术分析
3.3 一维重构与二维重构对比研究
3.4 动态可重构系统应用研究
第4章 动态局部可重构SOC计与实现
4.1 系统开发平台介绍
4.2 DPR-SoC系统架构设计
4.2.1 单芯片FPGA上DPR-SoC系统框架
4.2.2 DPR-SoC硬件构架及外设
4.3 DPR-SOC软/硬件协同设计方法及流程
4.3.1 系统软/硬件设计总流程
4.3.2 系统EAPR设计过程
4.3.3 系统地址空间分配及互连
4.4 DPR-SoC系统软件设计
4.4.1 软件系统结构
4.4.2 用户软件设计
第5章 可重构SOC系统软/硬件任务协调处理原理及方法研究
5.1 实时操作系统μC/OS-Ⅱ简介
5.2 实时操作系统μC/OS-Ⅱ在DPR-SoC系统上移植
5.2.1 OS_CPU.H文件移植
5.2.2 OS_CPU_C.C文件移植
5.2.3 OS_CPU_A.ASM文件移植
5.3 DPR-SoC软/硬件任务协调处理原理和方法研究
5.2.1 硬件任务定义
5.2.2 软/硬件任务协调处理研究的必要性
5.2.3 软/硬件任务协调处理原理研究
5.2.4 基于能耗近似最优的软/硬件任务协调处理方法设计
第6章 实验结果及性能评估
6.1 系统参数确定
6.2 实验结果分析
6.2.1 资源利用评估
6.2.2 配置时隙分析
6.2.3 软/硬件任务协调处理性能分析
6.3 实验小节
第7章 总结与展望
7.1 总结
7.2 研究展望
致谢
参考文献
附录
杭州电子科技大学;