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Implementation of a volume rendering on coarse-grained reconfigurable multiprocessor

机译:在粗粒粒度可重配置多处理器上实现卷渲染

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摘要

In this paper, we present reconfigurable multiprocessor architecture for volume rendering. The multiprocessor consists of sixteen reconfigurable processors to exploit data parallelism of the volume rendering. Each processor has VLIW core and reconfigurable coarse-grained array specialized for control and data-intensive part of the program, respectively. The coarse-grained array can be configured dynamically, so that it can efficiently process different kernels of the volume rendering. The multiprocessor is implemented using verilog HDL and realized onto a commercial FPGA-based prototyping system. The experimental result shows that the presented multiprocessor has comparable performance to high-end desktop GPUs.
机译:在本文中,我们呈现了可重新配置的多处理器架构进行卷渲染。 多处理器由十六个可重构处理器组成,用于利用卷渲染的数据并行性。 每个处理器都有VLIW核心和可重新配置的粗粒阵列,专门用于程序的控制和数据密集型部分。 可以动态地配置粗粒阵列,以便它可以有效地处理体积渲染的不同内核。 多处理器使用Verilog HDL实现,并实现到基于商业FPGA的原型系统。 实验结果表明,所示的多处理器对高端桌面GPU具有相当的性能。

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