机译:嵌入式神经网络处理精密可伸缩乘积单元架构的回顾与基准
机译:使用并行软件框架的基于FPGA的图像处理的并行嵌入式处理器架构
机译:用于第一代英特尔®至强融核™处理器体系结构的Hartree-Fock-Roothaan方法的高效MPI / OpenMP并行化
机译:神经网络处理器的并行架构
机译:使用无状态并行处理体系结构的自动程序并行化。
机译:围绕Medoids(PAM)算法进行分区的并行体系结构可实现可扩展的多核处理器及其在医疗保健中的应用
机译:神经网络分类器的模拟处理器架构
机译:传感器阵列处理并行架构的开发。第2卷。宽带波达方向估计的并行体系结构。