Department of Information Technology, Bengal Engineering Science University, Shibpur, Howrah 711103, Indiac;
Advanced Encryption Standard; Reversible logic; low-power synthesis;
机译:利用功率分析抗攻击可逆逻辑门设计AES算法的子字节和InvSubBytes转换
机译:带有逻辑S-box的AES算法的硬件实现
机译:基于硅基P-N结逻辑器件的可逆逻辑门的设计与实现
机译:AES算法的可逆逻辑实现
机译:一种用于实现AES 128算法的新型低功率架构,用于植入心脏装置
机译:一种使用QCA实现具有成本效益的算术逻辑电路的新型可逆逻辑门及其系统方法
机译:使用HNG可逆逻辑门的可逆控制和完整加法器单元实现