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时钟偏斜补偿电路设计

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时钟系统的稳定性直接决定了在不同操作环境下时钟偏斜值的大小,并影响芯片的可靠性.本文讨论了X数字协处理器中的时钟偏斜补偿电路设计及实现技术,为提高时钟系统的稳定性并提高在不同操作条件下的可靠性,从电路设计、版图实现的角度采取了有效措施,有效地提高了芯片的可靠性.

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来源
《第十届计算机工程与工艺全国学术年会》|2006年|273-276|共4页
会议地点桂林
作者
曾献君; 陈亮; 罗礼;
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作者单位

中国计算机学会;

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会议组织
正文语种
原文格式 PDF
中图分类数字集成电路、逻辑集成电路;
关键词
时钟偏斜值; 时钟偏斜补偿; 芯片可靠性; 数字处理器; 补偿电路设计;

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