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800MSPS FADC数据采样系统

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本文开发了一种基于MAX105 800MSPS 6bit FADC和FPGA的高速数据采样系统.FADC的输出通过FPGA中的串并转换电路降低到100MHz,便于后续数据处理和传输.FPGA还实现了数据缓存、自甄别触发以及压缩和时间信息获取等功能.经过压缩和缓存的数据由TELL1采集并传送计算机,最大数据带宽可达4Gbps.

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来源
《第十三届全国核电子学与核探测技术学术年会》|2006年|9-12|共4页
会议地点西安
作者
王振华; 李楠; 刘以农; 邓智;
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作者单位

中国电子学会;

中国核学会;

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会议组织
正文语种
原文格式 PDF
中图分类 TL822.6;
关键词
高速采样; FADC; FPGA; TELL1; 数据采集;
入库时间 2022-08-17 10:41:07

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1. 800MSPS FADC数据采样系统的研制 [J] . 王振华 ,李楠 ,刘以农 . 核电子学与探测技术 . 2008,第002期
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800MSPS FADC数据采样系统

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