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李康; 林钰凯; 马佩军; 史江义; 梁亮;
西安电子科技大学宽禁带半导体材料与器件国防重点实验室;
数字信号处理; 乘法器电路; 编码; 低功耗;
机译:SFQ并行乘法器中的最终加法器电路与树状结构的部分积加法器电路的比较
机译:使用重新排序的法线基础的串行输入并行输出有限域乘法器的高速硬件实现
机译:使用新型部分乘积发生器和4:2压缩器的紧凑型快速并行乘法器的设计和分析,用于高速DSP应用
机译:基于Radix-4部分积生成的近似乘法器,用于高速和低功耗数字信号处理
机译:高速数组乘法器的并行(p,q)计数器的实现
机译:优化基于SSVEP的BCI系统实现实用高速拼写
机译:基于高速携带选择器的计算共享乘法器实现FIR滤波器的VLSI实现
机译:并行切线和最速下降优化算法 - 一种应用于部分线性模型的计算机实现
机译:一种减小乘法器面积,生成用于高速运算的部分乘积并实现部分乘积加法器树的方法
机译:基于卫星和基于陆地的无线通信链路动态组合,具有高速多链路盒,其结构具有接口,其中管理的实现是通过来自地理部分的配置文件执行的
机译:使用基于光电二极管的CMOS图像形成部分实现高速芯片上的窗口集中
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