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陈弘毅; 岳震五; 顾群;
不详;
乘法器; 流水线; 多米诺电路; 寄存器;
机译:基于位级流水线阵列结构的CMOS VLSI自定时乘法器体系结构的设计与表征
机译:使用新的流水线全加法器单元设计的CMOS乘法器-累加器的位级流水线实现
机译:10位流水线ADC设计。
机译:一种用于前庭假体的低功耗时分多路复用矢量矩阵乘法器
机译:spIm(斯坦福流水线迭代乘法器):流水线64 X 64位迭代乘法器
机译:流水线级高速乘法器
机译:乘法器流水线优化与位折叠校正
机译:使用4位乘4位乘法器和级联加法器的快速n位乘n位乘法器
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